From 95997aac1be995dce6bc6fdb01a2880242700e8f Mon Sep 17 00:00:00 2001 From: vin Date: Mon, 1 Dec 2025 17:13:00 -0500 Subject: fix mux16 layout input ordering --- vlsi/memory.jelib | 153 +++++++++++++++++++++++++++--------------------------- 1 file changed, 77 insertions(+), 76 deletions(-) (limited to 'vlsi/memory.jelib') diff --git a/vlsi/memory.jelib b/vlsi/memory.jelib index 223ce97..4da9b52 100644 --- a/vlsi/memory.jelib +++ b/vlsi/memory.jelib @@ -883,7 +883,7 @@ Ez||D5G2;|pin@40||O X # Cell mux16;1{lay} -Cmux16;1{lay}||mocmos|1764469982530|1764483729987||DRC_last_good_drc_area_date()G1764483752407|DRC_last_good_drc_bit()I18|DRC_last_good_drc_date()G1764483752407 +Cmux16;1{lay}||mocmos|1764469982530|1764625044286||DRC_last_good_drc_area_date()G1764625047220|DRC_last_good_drc_bit()I18|DRC_last_good_drc_date()G1764625047220 Ngeneric:Facet-Center|art@0||0|0||||AV NMetal-1-Metal-2-Con|contact@0||-9|880|||| NMetal-1-Metal-2-Con|contact@1||134|880|||| @@ -920,6 +920,7 @@ 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