fix mux16 layout input ordering

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diff --git a/vlsi/memory.jelib b/vlsi/memory.jelib
index 223ce97..4da9b52 100644
--- a/vlsi/memory.jelib
+++ b/vlsi/memory.jelib
@@ -883,7 +883,7 @@ Ez||D5G2;|pin@40||O
 X
 
 # Cell mux16;1{lay}
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 X
 
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